EDA e IP (Novembro 2020)

Ferramenta Cambridge converte a descrição Verilog em C

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A Tenison EDA disse que sua ferramenta VTOC permitirá que os designers produzam modelos C eficientes de seu hardware, acelerando os processos de gravação e verificação de software

Arithmatica lança bibliotecas IP de matemática para ICs

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As bibliotecas de IP destinam-se a ICs intensivos em matemática, como chips gráficos e processadores de última geração

Empresa de Oxford ganha financiamento para a tecnologia SoC

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A tecnologia do sistema no chip espera facilitar a integração de hardware e software

A fé da ARM em seu modelo de negócios IP é recompensada com novo crescimento

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Novas aplicações e novas tecnologias estão impulsionando o crescimento, diz executivo-chefe

Magma adiciona otimização de energia

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Otimização e gerenciamento de energia foram adicionados ao software de design de chips da Magma Design Automation.

Mudança de regra na China levanta preocupações com roubo de IP

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Espera-se que a ameaça do roubo de propriedade intelectual da China piore nos próximos sete meses, à medida que o país começa a levantar restrições sobre

MoSys culpa a perda por falta de aquisição

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Empresa diz que compra cancelada pela Synopsys é responsável por perdas trimestrais

Fister deixa a Intel para Cadence

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Bingham nomeado presidente do conselho da Cadence

ARM revela núcleos de multiprocessamento e DSP

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Frutos da colaboração com a NEC e aquisição da Adelante

A ferramenta EDA rastreia energia e ruído no pacote

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Empresa iniciante resolve problemas de gerenciamento de energia

Synopsys desembrulha a plataforma de design Galaxy

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Promessas de melhorias em toda a gama de ferramentas de design de chips

A receita da Synopsys subiu ligeiramente

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Empresa da EDA gerencia crescimento de 1% em relação ao trimestre do ano passado

Start-up da EDA garante financiamento de US $ 9 milhões

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Golden Gate com foco na EDA para chips de baixa potência

A ferramenta de síntese C interna é exibida em público

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A Mentor Graphics está lançando no mercado um produto de síntese C que estava disponível anteriormente para selecionar clientes. A catapulta C utiliza C padrão ou C ++, sem

Inicialização da EDA ajuda no fechamento do projeto de 90nm

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Roteador otimiza fio por fio

DAC: mercado de IP cresce 22%

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Crescimento do aumento do número de núcleos, falta de capacidade de engenharia e crescente importância dos FPGAs

DAC: EDA e IP obtêm espírito

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Padrão de como o IP é implementado nas ferramentas da EDA é lançado pelo Spirit Consortium

DAC: EDA precisa ir quântico

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Pat Gelsinger, da Intel, diz que a progressão da Lei de Moore mudará fundamentalmente as ferramentas necessárias para projetar chips

DAC: Cadence empurra pacote multi-chip

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Múltiplos dados em um pacote visto como solução para o aumento dos custos da Asic

DAC: Altera empurra HardCopy com Synopsys

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Empresa programável espera aumentar a demanda por versões cabeadas de seus FPGAs